Quá trình hình thành phương pháp truyền tập tin dữ liệu số thông qua giao tiếp giữa các tập tin p6

Để vi xử lý giao tiếp với những thiết bị bên ngoài, người ta thường dùng vi mạch giao tiếp 8255A, vi mạch này có khả năng giao tiếp rất rộng, vừa có thể xuất dữ liệu, vừa có thể nhận dữ liệu tùy theo người lập trình điều khiển bằng cách thay đổi t`ông số của thanh ghi điều khiển.
Nội dung trích xuất từ tài liệu:
Quá trình hình thành phương pháp truyền tập tin dữ liệu số thông qua giao tiếp giữa các tập tin p6 Tröôøng ÑH SPKT Luaän vaên toát nghieäp GIAO TIEÁP SONG SONG DUØNG CHÖÔNG VI: VI MAÏCH 8255 I. GIÔÙI THIEÄU VEÀ VI MAÏCH 8255A: Ñeå vi xöû lyù giao tieáp vôùi nhöõng thieát bò beân ngoaøi, ngöôøi ta thöôøng duøng vi maïch giao tieáp 8255A, vi maïch naøy coù khaû naêng giao tieáp raát roäng, vöøa coù theå xuaát döõ lieäu, vöøa coù theå nhaän döõ lieäu tuøy theo ngöôøi laäp trình ñieàu khieån baèng caùch thay ñoåi t`oâng soá cuûa thanh ghi ñieàu khieån. II. SÔ ÑOÀ CHAÂN, SÔ ÑOÀ LOGIC, CHÖÙC NAÊNG CAÙC CHAÂN CUÛA VI MAÏCH 8255A. Sô ñoà chaân vaø sô ñoà logic cuûa vi maïch 8255A ñöôïc theå hieän qua hình veõ: PA3 1 40 PA4 PA2 PA5 PA1 PA6 PA0 PA7 PA0 – PA7 D0 – D7 RD\ WR\ CS\ RESET 8255A GND D0 A1 D1 A0 D2 8255A RD\ PC 7 D3 PB0 – PB7 PC 6 D4 WR \ PC 5 D5 RESET PC 4 D6 PC 0 D7 PC 1 V cc A0 PC 2 PB7 A1 PC0 – PC7 PC 3 PB6 PB 0 PB5 CS \ PB 1 PB4 PB 2 20 21 PB3 Hình 6.1 : Sô ñoà chaân vaø sô ñoà logic cuûa vi maïch 8255A Trong ñoù: Chaân 1  4, 37  40 (PA0 – PA7): laø caùc ñöôøng xuaát nhaäp coù teân laø coång A. Chaân 18  25 (PB0 – PB7): laø caùc ñöôøng nhaäp xuaát coù teân coång B. Chaân 10  13, 14  17 (PB0 – PB7): laø caùc ñöôøng nhaäp xuaát coù teân coång C. Chaân 27  34 (D0 – D7): laø caùc ñöôøng döõ lieäu (data) hoaït ñoäng hai chieàu, daãn tín hieäu ñieàu khieån töø vi xöû lyù ra caùc thieát bò beân ngoaøi ñoàng thôøi nhaän caùc döõ lieäu töø caùc thieát bò ñieàu khieån beân ngoaøi vaøo vi xöû lyù. Chaân 35 (Reset input): ngoõ vaøo xoùa, chaân reset phaûi ñöôïc noái vôùi tín hieäu reset out cuûa vi xöû lyù ñeå khoâng laøm aûnh höôùng ñeán maïch ñieàu khieån. Khi reset, caùc coång GVHD: Nguyeãn Ñình Phuù SVTH: Nguyeãn Trung Duõng Tröôøng ÑH SPKT Luaän vaên toát nghieäp cuûa 8255A laø caùc ngoõ vaøo, ñoàng thôøi taát caû caùc döõ lieäu treân thanh ghi beân trong 8255A ñeàu bò xoùa, 8255A trôû veà traïng thaùi ban ñaàu saên saøng laøm vieäc. Chaân 6 (CS\): tín hieäu ngoõ vaøo chip select (CS\) ñöôïc ñieàu khieån bôûi vi xöû lyù, duøng ñeå löïa choïn 8255A laøm vieäc khi vi xöû lyù giao tieáp vôùi nhieàu thieát bò. Chaân 5 (RD\): ngoõ vaøo ñoïc döõ lieäu (Read Input). Chaân 36 (WR\) : ngoõ vaøo ghi döõ lieäu (Write Input). Chaân 8,9 (A1, A0): ngoõ vaøo ñòa chæ (Address Input), duøng nhaän ñòa chæ vaøo ñeå löïa choïn thanh ghi vaø caùc coång. Baûng ñòa chæ löïa choïn thanh ghi vaø caùc coång: A1 A0 Coång vaø thanh ghi 0 0 Coång A 0 1 Coång B 1 0 Coång C 1 1 Thanh ghi ñieàu khieån Chaân 26 (Vcc) : nguoàn 5 VDC. Chaân 7 (GND) : GND 0 VDC. III. CAÁU TRUÙC BEÂN TRONG VAØ HOAÏT ÑOÄNG CUÛA VI MAÏCH 8255A. 1. Sô ñoà khoái caáu truùc beân trong cuûa vi maïch 8255A. PA7 – PA0 Port A Ñieàu khieån PC7 – PC4 nhoùm A Port C Ñeäm bus (4 bit cao) D7 – D0 döõ lieäu Nhoùm A PC3 – PC0 Port C (4 bit thaáp) Ñieàu khieån PB7 – PC0 RD\ nhoùm B Logic WR \ ñieàu Port B CS\ khieån A0 ghi/ñoïc ...