Bài giảng : Mạch tuần tự Flip Flop và ghi dịch part 2
Số trang: 10
Loại file: pdf
Dung lượng: 3.13 MB
Lượt xem: 9
Lượt tải: 0
Xem trước 2 trang đầu tiên của tài liệu này:
Thông tin tài liệu:
Tham khảo tài liệu bài giảng : mạch tuần tự flip flop và ghi dịch part 2, kỹ thuật - công nghệ, điện - điện tử phục vụ nhu cầu học tập, nghiên cứu và làm việc hiệu quả
Nội dung trích xuất từ tài liệu:
Bài giảng : Mạch tuần tự Flip Flop và ghi dịch part 25.1 MẠCH CHỐT RS VÀ FLIP FLOP RS1. Flip Flop nảy ở mức cao hay mức thấp của đồng hồ:Clock tác động ở mức cao: Clock tác động ở mức thấp: Khi đông hồ ở mức cao: Khi đông hồ ở mứcthì ngõ vào thay đổi sẽ làm ngõ ra thấp: thì ngõ vào thay đổi sẽ làmthay đổi. ngõ ra thay đổi.Khi đồng hồ ở mức Khi đồng hồ ở mức cao:thấp: bất chấp ngõ vào thay đổi bất chấp ngõ vào thay đổi thì ngõthì ngõ ra cũng không đổi ra cũng không đổi Q S Q S CK CK Q R Q R5.2 FLIP FLOP JK: 1. Cấu tạo mạch chốt: Flip flop JK dùng để khắc phục hiện tượng ngõ ra bất ổn Q (Q và tạm thời ở cùng trạng thái) do cả S và R cùng ở mức cao5.2 FLIP FLOP JK: 1. Cấu tạo mạch chốt: Flip flop JK có cấu tạo gồm flip flop RS có mắc thêm 2 cổng AND để tránh trạng thái cấm. Do sự hồi tiếp của Q ngõ vào FF RS là S =J , R =KQ. Mạch hoạt động theo bảng chân trị như hình vẽ sau:5.2 FLIP FLOP JK:5.2 FLIP FLOP JK: 1. Sự đua vòng quanh: flop JK có đồng hồ tác động vào tầng đầu thay Flip vì vào FF RS. τ Mạch của FF JK và sự đưa vòng quanh 5.2 FLIP FLOP JK: 1. Cấu tạo chủ tớ: Để tránh sự đua vòng quanh, ta cấu tạo flip flop JK như sau: MASTER SLAVE 1CK 05.2 FLIP FLOP JK: 1. Cấu tạo chủ tớ: Tầng tớ đổi trạng thái tức FF đổi trạng thái khi từ CK = 1 xuống CK = 0 nên trong ký hiệu của FF chủ tớ, người ta thêm dấu để biểu thị điều này. Mạch FF chủ tớ được nảy bởi | | mức hay bởi xung. J | | Q CK | | Q K5.2 FLIP FLOP JK:1. Flip Flop nảy bằng cạnh (sườn) của đồng hồ: Ta có thể tránh hiện tượng đua vòng quanh nếu xung đồng hồ hẹp và đã cách làm cho flip flop chuyển mạch theo cạnh (sườn) (Edge triggered) thay vì theo mức.FF 74LS109AN – JK Possitive Edge Triggered flip flop J K CK Q ↑ 0 0 Q0 CK ↑ 0 1 0 ↑ 1 0 1 ↑ 1 1 Q0FF 74LS112AN – JK Negative Edge Triggered Flip flop J R CK Q ↓ 0 0 Q0 J Q ↓ 0 1 0 CK ↓ 1 0 1 R Q ↓ 1 1 Q0
Nội dung trích xuất từ tài liệu:
Bài giảng : Mạch tuần tự Flip Flop và ghi dịch part 25.1 MẠCH CHỐT RS VÀ FLIP FLOP RS1. Flip Flop nảy ở mức cao hay mức thấp của đồng hồ:Clock tác động ở mức cao: Clock tác động ở mức thấp: Khi đông hồ ở mức cao: Khi đông hồ ở mứcthì ngõ vào thay đổi sẽ làm ngõ ra thấp: thì ngõ vào thay đổi sẽ làmthay đổi. ngõ ra thay đổi.Khi đồng hồ ở mức Khi đồng hồ ở mức cao:thấp: bất chấp ngõ vào thay đổi bất chấp ngõ vào thay đổi thì ngõthì ngõ ra cũng không đổi ra cũng không đổi Q S Q S CK CK Q R Q R5.2 FLIP FLOP JK: 1. Cấu tạo mạch chốt: Flip flop JK dùng để khắc phục hiện tượng ngõ ra bất ổn Q (Q và tạm thời ở cùng trạng thái) do cả S và R cùng ở mức cao5.2 FLIP FLOP JK: 1. Cấu tạo mạch chốt: Flip flop JK có cấu tạo gồm flip flop RS có mắc thêm 2 cổng AND để tránh trạng thái cấm. Do sự hồi tiếp của Q ngõ vào FF RS là S =J , R =KQ. Mạch hoạt động theo bảng chân trị như hình vẽ sau:5.2 FLIP FLOP JK:5.2 FLIP FLOP JK: 1. Sự đua vòng quanh: flop JK có đồng hồ tác động vào tầng đầu thay Flip vì vào FF RS. τ Mạch của FF JK và sự đưa vòng quanh 5.2 FLIP FLOP JK: 1. Cấu tạo chủ tớ: Để tránh sự đua vòng quanh, ta cấu tạo flip flop JK như sau: MASTER SLAVE 1CK 05.2 FLIP FLOP JK: 1. Cấu tạo chủ tớ: Tầng tớ đổi trạng thái tức FF đổi trạng thái khi từ CK = 1 xuống CK = 0 nên trong ký hiệu của FF chủ tớ, người ta thêm dấu để biểu thị điều này. Mạch FF chủ tớ được nảy bởi | | mức hay bởi xung. J | | Q CK | | Q K5.2 FLIP FLOP JK:1. Flip Flop nảy bằng cạnh (sườn) của đồng hồ: Ta có thể tránh hiện tượng đua vòng quanh nếu xung đồng hồ hẹp và đã cách làm cho flip flop chuyển mạch theo cạnh (sườn) (Edge triggered) thay vì theo mức.FF 74LS109AN – JK Possitive Edge Triggered flip flop J K CK Q ↑ 0 0 Q0 CK ↑ 0 1 0 ↑ 1 0 1 ↑ 1 1 Q0FF 74LS112AN – JK Negative Edge Triggered Flip flop J R CK Q ↓ 0 0 Q0 J Q ↓ 0 1 0 CK ↓ 1 0 1 R Q ↓ 1 1 Q0
Tìm kiếm theo từ khóa liên quan:
Mạch tuần tự Mạch tổ hợp Cấu tạo mạch tài liệu điện tử giáo trình điện tủTài liệu liên quan:
-
Cơ Sở Điện Học Truyền Thông - Tín Hiệu Số part 1
9 trang 184 0 0 -
Giáo trình kỹ thuật số - Phần 1 Đại số Boolean và vi mạch số - Chương 2
10 trang 159 0 0 -
Tìm hiểu về động cơ không đồng bộ phần 1
27 trang 138 0 0 -
Kỹ thuật số - Chương 4 Mạch tổ hợp (Combinational Circuits)
56 trang 76 0 0 -
Bài giảng điện tử môn hóa học: chuyển đổi giữa khối lượng, thể tích và lượng chất
13 trang 63 0 0 -
Điều khiển logic và ứng dụng: Phần 1
116 trang 61 0 0 -
Giáo án điện tử công nghệ: công nghệ cắt gọt kim loại
18 trang 50 0 0 -
Hướng dẫn thiết kế mạch và lập trình PLC - Trần Thế San
228 trang 46 0 0 -
Giáo trình Giải tích mạng điện - Lê Kim Hùng
143 trang 45 0 0 -
Giáo trình Thí nghiệm điện tử công suất - ĐH Công Nghiệp Tp HCM
238 trang 42 0 0